Ändra sökning
RefereraExporteraLänk till posten
Permanent länk

Direktlänk
Referera
Referensformat
  • apa
  • harvard1
  • ieee
  • modern-language-association-8th-edition
  • vancouver
  • Annat format
Fler format
Språk
  • de-DE
  • en-GB
  • en-US
  • fi-FI
  • nn-NO
  • nn-NB
  • sv-SE
  • Annat språk
Fler språk
Utmatningsformat
  • html
  • text
  • asciidoc
  • rtf
Handling Shared Variable Synchronization in Multi-core Network-on-Chips with Distributed Memory
KTH, Skolan för informations- och kommunikationsteknik (ICT), Elektroniksystem.
KTH, Skolan för informations- och kommunikationsteknik (ICT), Elektroniksystem.ORCID-id: 0000-0003-0061-3475
KTH, Skolan för informations- och kommunikationsteknik (ICT), Elektroniksystem.
2010 (Engelska)Ingår i: Proceedings: IEEE International SOC Conference, SOCC 2010, 2010, 467-472 s.Konferensbidrag, Publicerat paper (Refereegranskat)
Abstract [en]

Parallelized shared variable applications running on multi-core Network-on-Chips(NoCs) require efficient support for synchronization, since communication is on the critical path of system performance and contended synchronization requests may cause large performance penalty. In this paper, we propose a dedicated hardware module forsynchronization management. This module is called Synchronization Handler (SH), integrated with each processor-memory node on the multi-core NoCs. It uses two physical buffers to concurrently process synchronization requests issued by the local processor and remote processors via the on-chip network. One salient feature is that the two physical buffers are dynamically allocated to form multiple virtual buffers (a virtual buffer is related to a shared synchronization variable) so as to improve the buffer utilization and alleviate the head-of-line blocking. Synthesis results suggest that the SH can run over 900 MHz in 130nm technology with small area overhead. To justify the SH-enhanced multicore NoCs, we employ synthetic workloads to evaluate synchronizationcost and buffer utilization, and run synchronization-intensive applications to investigate speedup. The results show that our approach is viable.

Ort, förlag, år, upplaga, sidor
2010. 467-472 s.
Nyckelord [en]
900 MHz, Buffer utilization, Critical Paths, Dedicated hardware, Distributed Memory, Head of line blocking, Multi core, Network-on-chips, On-chip networks, Performance penalties, Process synchronization, Processor-memory, Remote processors, Salient features, Shared variables, Small area, Synchronization cost, Synthetic workloads
Nationell ämneskategori
Elektroteknik och elektronik
Identifikatorer
URN: urn:nbn:se:kth:diva-63635DOI: 10.1109/SOCC.2010.5784680Scopus ID: 2-s2.0-79960729241ISBN: 978-142446683-2 (tryckt)OAI: oai:DiVA.org:kth-63635DiVA: diva2:482825
Konferens
23rd IEEE International SOC Conference, SOCC 2010, Las Vegas, NV, 27 September 2010 through 29 September 2010
Anmärkning
Key: Nostrum. QC 20120209Tillgänglig från: 2012-01-24 Skapad: 2012-01-24 Senast uppdaterad: 2012-02-09Bibliografiskt granskad

Open Access i DiVA

Fulltext saknas

Övriga länkar

Förlagets fulltextScopushttp://web.it.kth.se/~axel/papers/2010/SOCC-XiaowenChen.pdf

Personposter BETA

Lu, Zhonghai

Sök vidare i DiVA

Av författaren/redaktören
Chen, XiaowenLu, ZhonghaiJantsch, Axel
Av organisationen
Elektroniksystem
Elektroteknik och elektronik

Sök vidare utanför DiVA

GoogleGoogle Scholar

doi
isbn
urn-nbn

Altmetricpoäng

doi
isbn
urn-nbn
Totalt: 44 träffar
RefereraExporteraLänk till posten
Permanent länk

Direktlänk
Referera
Referensformat
  • apa
  • harvard1
  • ieee
  • modern-language-association-8th-edition
  • vancouver
  • Annat format
Fler format
Språk
  • de-DE
  • en-GB
  • en-US
  • fi-FI
  • nn-NO
  • nn-NB
  • sv-SE
  • Annat språk
Fler språk
Utmatningsformat
  • html
  • text
  • asciidoc
  • rtf